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基於Quartus Ⅱ的數字系統Verilog HDL設計實例詳解 封面

基於Quartus Ⅱ的數字系統Verilog HDL設計實例詳解

周潤景 蘇良碧編著

440人在讀
27.2萬字總字數
¥23.2定價

內容簡介

本書以實例詳解的方式介紹以Quartus II 9.0爲設計平臺的FPGA/CPLD數字系統設計。書中的實例包括簡單的數字邏輯電路實例、數字系統設計實例,以及複雜數字系統設計實例,由淺入深地介紹了採用Quartus II進行數字系統開發的設計流程、設計思想和設計技巧。

書籍信息

作者周潤景 蘇良碧編著
出版社電子工業出版社
出版時間2010-05-01
ISBN9787121107412
分類科學技術-工業技術
格式EPUB
完結狀態連載中
章節數89